1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana...

12
1 Circuitos Digitales Circuitos Digitales II y Lab. II y Lab. Arquitectura de Punto Flotante Semana No.14 Semana No.14 Semestre 2011-2 Semestre 2011-2 Prof. Eugenio Duque Pérez Prof. Eugenio Duque Pérez [email protected] Prof. Gustavo Patiño Álvarez (en comisión) Prof. Gustavo Patiño Álvarez (en comisión) [email protected] Departamento de Ingeniería Electrónica Departamento de Ingeniería Electrónica Facultad de Ingeniería Facultad de Ingeniería

Transcript of 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana...

Page 1: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

1

Circuitos Digitales II y Circuitos Digitales II y Lab.Lab.

Arquitectura de Punto FlotanteSemana No.14Semana No.14

Semestre 2011-2Semestre 2011-2

Prof. Eugenio Duque PérezProf. Eugenio Duque Pé[email protected]

Prof. Gustavo Patiño Álvarez (en comisión)Prof. Gustavo Patiño Álvarez (en comisión)[email protected]

Departamento de Ingeniería ElectrónicaDepartamento de Ingeniería Electrónica

Facultad de IngenieríaFacultad de Ingeniería

Page 2: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

2

Page 3: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

3

Page 4: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

4

Page 5: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

5

Page 6: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

6

Page 7: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

7

Page 8: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

8

Page 9: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

9

Page 10: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

Align the decimal point of the number that has the smaller exponent.

Add the decimal numbers. The exponent is common. The result must be normalized. Scientific notation. Round the result taking in consideration the spaces

for decimal digits.

The binary floating point addition, has a similar behavior.

Show examples.

Decimal Floating Point addition

10

Page 11: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

Add of exponents. Multiply the bases. Normalize the result. Round the result taking in account the spaces for

decimal digits.

Binary floating multiplication has similar behavior but is necessary to correct the double add of bias

Example. Decimal and binary

Decimal Floating Point multiplication.

11

Page 12: 1 Circuitos Digitales II y Lab. Circuitos Digitales II y Lab. Arquitectura de Punto Flotante Semana No.14 Semestre 2011-2 Prof. Eugenio Duque Pérez eaduque@udea.edu.co.

Computer Organization and Design. The Hardware /Software Interface. David Patterson and John Hennessy. Pp. 275-300

IEEE 754 Estándar Floating-Point. mth

Exercises Parcial_2_09-01.pdf

Bibliography

12