FIEC00299 Sistemas Digitales I.

CO-REQUISITOS

EQUIVALENTE A:

CONVALIDA CON:

ESCUELA SUPERIOR POLITECNICA DELLITORAL HEE -W

PROGRAMA DE ESTUDIOS

SISTEMAS DIGITALES II

UNIDAD ACADÉMICA: Facultad de Ingeniería en Electricidad y ComputaciónCARRERA: Ingeniería en Electricidad, Ingeniería en Telemática,

Ingeniería en Computación e Ingeniería en Electrónica yTelecomunicaciones.

ESPECIALIZACIÓN: Industrial y Sistemas Tecnológicos.ÁREA: Electrónica

TIPO DE MATERIA: TEÓRICA X PRÁCTICA

DE DE FORMACIÓN: Profesional

1. NOMBRE DE LA ASIGNATURA.MATERIA:

FIEC00745 SISTEMAS DIGITALES II.PRE-REQUISITOS

CÓDIGO:

CRÉDITOS/HORAS/SEMANALES TEÓRICOS: 4

PRÁCTICOS:

PROFESOR RESPONSABLE

Ing. Ludmila Gorenkova

2. OBJETIVOS

Diseñar e implementar circuitos secuenciales sincrónicos.Utilizar circuitos integrados MSI y LSI en la implementación decircuitos secuenciales sincrónicos.Utilizando lenguaje de descripción de hardware (VHDL) crear

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circuitos digitales combinatoriales y secuenciales.Describir, diseñar y simular Sistemas Digitales usando herramientas deCAD y lenguaje de descripción de hardware (VHDL).

3. PROGRAMA RESUMIDO

Diseño intuitivo de los Sistemas Digitales.Circuitos secuenciales sincrónicos.Memorias RAM.Diseño formal de los Sistemas Digitales.Circuitos secuenciales asincrónicos.

4. PROGRAMA DETALLADO

INTRODUCCION.

DISEÑO INTUITIVO DE LOS SISTEMAS DIGITALES.1.1 Ejemplos de diseño intuitivo por Partición Funcional de los Sistemas

Digitales.

CIRCUITOS SECUENCIALES SINCRÓNICOS.2.1 Introducción. Diagrama de bloques general.MSS modelo Moore y MSS modelo Mealy.Diagrama de estados.Procedimiento general del diseño de una MSS con método tradicional

de diagrama de estados.Asignación de códigos de estado.Diseño de una MSS usando herramientas CAD y código VHDL.Estilo alternativo del código VHDL. Asignación de códigos de estado en

VHDL.Diseño de una MSS con método de un flip — flop por estado (one-hot

encoding).Diseño de una MSS modelo Mealy.2.10 Minimización de los estados.2.11 Problemas de sincronismo.2.12 Diseño de contadores.2.13 Ejemplos de diseño de MSS. Análisis de MSS. Uso de memoria

ROM en el diseño de MSS.

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2.14 Diagrama ASM. Diseño de una MSS con Diagrama ASM.

MEMORIAS RAM.3.1 Introducción.3.2 Clasificación de memorias RAM.3.3 Estructura y características de la memoria RAM estática.3.4 SRAM comerciales. SRAM sincrónicas.3.5 Estructura y características de la memoria RAM dinámica.3.6 DRAM comerciales. DRAM sincrónicas.

DISENO FORMAL DE LOS SISTEMAS DIGITALES.4.1 Introducción.4.2 Diagrama de bloques general.4.3 Circuito controlador y procesador de datos.4.4 Partición funcional.4.5 Procedimiento general del diseño de un Sistema Digital.4.6 Estructura general del código VHDL en el diseño de un Sistema

Digital.4.7 Ejemplos del diseño de Sistemas Digitales.

5. CIRCUITOS SECUENCIALES ASINCRÓNICOS.Introducción.Modelo general del circuito secuencial.Análisis del comportamiento de una MSA en modo fundamental.Diseño de una MSA.Condiciones de carrera no critica y critica.Hazards. Método para eliminar los hazards estáticos.Diseño de un flip-flop tipo D con clock de disparo por flanco positivo.Ejemplos de diseño de las MSA.

6. TEXTO GUÍA

Brown S. & Vranesic Z., Fundamentos de Lógica Digital con diseño VHDL,McGraw Hill, 2004.

7. BIBLIOGRAFÍA

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Wakerley J., Digital Design, Principies and Practices, McGraw Hill,2001.Pérez S. & Soto E., Diseño de Sistemas Digitales con VHDL, Thomson.2002.Villar E. y otros, VHDL Lenguaje estándar de diseño electrónico,McGraw Hill, 1998.Mandado E. y otros, Dispositivos Lógicos Programables y susAplicaciones. Thomson, 2002.

> Fletcher W., An Engineering Approach to Digital Design, Prentice Hall,1980.Tocci R., Sistemas Digitales, Principios y Aplicaciones. Prentice Hall,2001.Hernandez A., Introducción al Diseño Digital de Circuitoscombinacionales y secuenciales. CIME, ISPJAE, 2002.Blanco N. y Carlos J. Libros Electrónicos para la Enseñanza de losCircuitos Lógicos, versión 2.1, CD, 2003.

8. VISADO

DECANO SECRETARIOACADÉMICOFACULTAD

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FECHA: 31 ipW08 FECHA: p. 1,015 FECHA: 31 ( 0 9.( 08

9. VIGENCIA DEL PROGRAMA

RESOLUCIÓN COMISIÓN ACADÉMICA: CAc-2008-539

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